「IEEE Std.1800-2005」として約１年ほど前に標準化された次世代HDVL（hardware description and verification language）の「SystemVerilog」。最近は，EDAツールの整備が進んだことなどを背景に，急速にユーザーに広がってきた。なかでも検証におけるアサーションやテストベンチでのSystemVerilogの適用が本格化している。
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